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納電子器件性能測試用的器件結(jié)構(gòu)及制備方法

691   編輯:管理員   來源:中冶有色技術(shù)網(wǎng)  
2023-03-18 15:10:02
本發(fā)明涉及一種納電子器件性能測試用的器件結(jié)構(gòu)及制備方法。它是在硅襯底材料上先沉積底電極材料,然后沉積電介質(zhì)材料,曝光,刻蝕成多孔狀,孔徑在50-200nm,間距2-5μm,接著向孔內(nèi)沉積相變材料,化學機械拋光,覆蓋掩膜板,沉積上電極。于是薄膜就被掩膜板分成很多小單元,而每個單元大小差不多,引線,簡單封裝,每個單元內(nèi)的小器件處于并聯(lián)狀態(tài),然后測試每個單元的性能。此外,可以通過改變掩模板的大小,把上電極做成各種尺寸,畫出一次函數(shù)關(guān)系,通過外延法得出截距,從而得到納米器件的本征性能。本發(fā)明解決了納米器件測量引線難的問題。由于這些小器件是并聯(lián)的,不會增加工作電壓,準確的反映出器件本身的性能。
聲明:
“納電子器件性能測試用的器件結(jié)構(gòu)及制備方法” 該技術(shù)專利(論文)所有權(quán)利歸屬于技術(shù)(論文)所有人。僅供學習研究,如用于商業(yè)用途,請聯(lián)系該技術(shù)所有人。
我是此專利(論文)的發(fā)明人(作者)
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